FPGA可编程逻辑器件芯片XCVU095-2FFVB2104E中文规格书

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摘要:DesigningwithFRACXODesigningwithFRACXOPhysicalInterfaceTable1throughTable3showtheportdefinitions.Table1:Clocks,Reset,andInterfacetotheTransceiverPortsSignalNameDirectionDescriptionRESET_IInputSynchronousreset.Active-High.Needseightclockcyclestoresetcorrectly.REF_CLK_IInputReferenceclock.Canbeanyclock(local,BUFG,pulse,etc.).TXOUTCLK_IInputConnectstoTXOUTCLKoftheserialtransceiverviaaBUFG_GT.SDM_DATA_O[24:0]OutputConnectstoSDM0/1DATAonthetransceiver.SDM_TOGGLE_OOutputConnectstoSDM0/1TOGGLEonthetransceiver.GTH,GTM,andGTYtransceiversinUltraScale+devicesonlyTable2:DebugPortsSignalNameDirectionDescriptionERROR_O[20:0]OutputOutputofphasedetector.Signednumber.VOLT_O[21:0]OutputOutputoflow

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